1楼:
个人理解:一言可copy
解之,是cp脉冲的下bai降沿有
du效 而非低电平有效
zhi 解释说 也就是下降沿有效是cp脉冲dao由高电平跳变到低电平的瞬间是有效的,当保持为低电平时,触发器保持状态 不触发 如果是低电平有效 一般是指电路功能脚在低电平时整体电路功能有效。你说的次态 呵呵 还真不理解
数字电路触发器的问题,图中用红色笔圈出的两个图,它们除了clk前面一个有小圈一个没有小圈,其他的都
2楼:黑豹
是的。copy
输入端小圈代表反相器,有小圈是下降沿触发,无小圈是上升沿触发。
电路结构相同,所以功能相同,只是对应的触发时刻不同。
仅仅看波形图自然是相同,结合时钟分析就有相位差。用同一个时钟触发,二者输出波形相差半个时钟周期。
比如说电路功能是分频器,作用仅仅是降低频率,二者的功能相同;如果用在计算机系统,输出波形与计算机时钟有关,二者的功能就不同。
关于数字逻辑中逻辑电路的问题,关于数字逻辑中逻辑电路的问题 150
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