1楼：匿名用户
如果四舍五入成立：4387/1.2=3655.83≈3656d=e48h=111001001000b
否则应该是e47h（取整。余数全舍）
2楼：匿名用户
a ,e48h q不知道对不对
先算出量程是1.2mv*4096＝4.9152 v
x＝4.387*4096/4.9152=3656=e48h
数字电路的一个问题 10
3楼：匿名用户
电子电路中高电平是电压高的状态，一般记为1。
电子电路中低电平是电压低的状态，一般记为0。
对于高低电平之间的电压属于不定电压，即加压后可变为高电平，降压变为低电平。
数字电路问题 100
4楼：无言叹人生无悔
同步是指与时钟同步，即时钟触发条件满足时检测清零信号是否有效，有效则在下一个时间周期的触发条件下，执行清零，异步是清零信号有效时，无视触发脉冲，立即清零。
例如74ls161采用异步清零，而74ls162,74ls163采用的是同步清零。在同步清零的计数器电路中，rd‘ 出现低电平后要等下一个clk信号到达时才能将触发器清零。而在异步清零的计数器电路中，只要rd’ 出现低电平，触发器立即被置零，不受clk的控制。
5楼：匿名用户
改委等28部门联合印发《关于对社会保险领域严重失信企业及其有关人员实施联合惩戒的合作备忘录》，若产生以下九种行为，将被列入社保严重失信、失范行为惩戒名单：
（一）用人单位未按相关规定参加社会保险且拒不整改的；
（二）用人单位未如实申报社会保险缴费基数且拒不整改的；
（三）应缴纳社会保险费却拒不缴纳的；
（四）隐匿、转移、侵占、挪用社会保险费款、**或者违规投资运营的；
数字电路问题，望高手指点，
6楼：青皮橘子
3.ab
二进制计数器：
a、每经一级触发器，输出脉冲的频率降低一倍b、每输入一个计数脉冲，最低位的q状态改变一次。 这两个是对的
4.ace
7楼：匿名用户
3.这里的触发器是指的d触发器，d触发器可以用作分频电路使用，使用分频电路使
输出脉冲的频率降低一倍 选a
4.四位二进制计数器，可以构成15进制计数器，2^4=16,从0开始计数到15(1111)进
位,计了15个数,故为15进制,选c
3.存储器以字为单位进行读写操作,存储器的字节的位数代表了这个芯片的处理位数,现在有8、16、32的处理芯片，就是指的存储器的位数。选a
1.存储器的构成单元有存储矩阵，地址译码，输入输出控制，选b、c、d楼主给分
8楼：无畏无知者
又拿作业到这里来做了，少玩下，留点时间看看书都知道了；
因为这些都是概念性的问题，不是很难理解的
9楼：匿名用户
我回答过无数的问题，但对于这种作业，从不回答，书上写得很清晰，望你好好学习，谨此
问个数字电路的问题
10楼：黑豹
高、低电平有个门限值（阀值），再代入 rc 充放电公式计算时间，麻烦。
工程的问题多数可以通过实验得出结果，产生一个近似的公式，对于电路设计精度足够了。
振荡器芯片手册会给出计算公式。一般设计时钟电路是不用门电路的，专用芯片的性能比通用芯片好。
如采用运放做比较器就不是好方法。
数字电路一个小问题
11楼：匿名用户
r2是针对g1而言，随便多大都可以。而r1必须＜r2，以免r2分流
数字电路问题，
12楼：
根据基本逻辑门，一次写出关系式，最终的出表达式。再利用逻辑运算公式化解即可。答案及过程 见 图。向左转|向右转
一个数字电子的问题 数字电路为什么不采用多值逻辑呢？？
13楼：匿名用户
技术达不到 另外也没有必要 因为多个经典逻辑(二值逻辑)组合在一起一样可以达到多值逻辑的效果
数字电路表示的都是布尔型 二进制 通俗地说就是（高电平为1 低电平为0）如果要实现多值逻辑 那还要出现个 （中电平） 那样会大大增加电路设计中的难度。从目前的技术来看也是很难达到的。再说一个二进制数虽然只能表示两种状态 但是二个二进制数就可以有四种组合 四种状态 以此照样可以产生多值逻辑。
数字电路系统中常用的最具代表性的脉冲信号是什么
1楼 匿名用户 电路 模电 数电 信号与系统，信号与系统是可以灵活的，前三个学完后学新系统就好学了。 电路基础一般是指电工电路。 模电就是电子里面的模拟电路 处理模拟信号的电路。 数电就是电子里面的数字电路 处理数字信号的电路。 模拟信号 大小随时间连续变化，如 常见的正弦波信号。 数字信号 大小不...
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各四十打数字,各四十打一个数字
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